AMD Epyc Venice-X : le 3D V-Cache revient avec 5,3 GHz
Après trois ans d'absence, AMD relance ses Epyc X riches en cache : Venice-X propose jusqu'à 96 cœurs, plus de 1 Go de L3 et 5,3 GHz, mais seulement fin 2027.
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giftdetect · le bon cadeau en quelques minutesAMD relance ses processeurs Epyc X, bardés de mémoire cache. Les Venice-X, conçus pour le calcul haute performance (HPC), offriront jusqu'à 96 cœurs et, grâce à l'empilement 3D V-Cache, une densité de cache L3 triplée, à plus d'un gigaoctet par socket. Il faudra patienter : AMD prévoit les premières livraisons au second semestre 2027.
Évoquées au CES plus tôt cette année, ces puces visent les charges techniques et scientifiques sensibles à la latence, comme la simulation numérique en mécanique des fluides et la conception électronique automatisée (EDA). AMD utilise lui-même des Epyc X pour des tâches d'EDA telles que la vérification fonctionnelle, qui simule le silicium pour s'assurer de son comportement. Selon Phil Steinke, AMD Fellow, garder davantage du modèle en cache évite aux cœurs d'attendre les échanges avec la mémoire système.
Même cache, fréquences nettement supérieures
Chacun des huit dies CPU au maximum est associé à une tuile SRAM de 96 Mo, soit 144 Mo de L3 par chiplet et 1 152 Mo par socket, comme sur les Genoa-X qu'ils remplacent. La différence tient aux fréquences : Venice-X atteint 5,3 GHz, contre 3,7 GHz pour Genoa-X.
Tout vient de l'assemblage. Auparavant, la SRAM était posée sur le chiplet de calcul, ce qui emprisonnait la chaleur et bridait les fréquences. Avec Zen 5, AMD a placé la tuile SRAM sous le die de calcul, ce qui permet aux puces de chauffer davantage et de tourner plus vite plus longtemps. Les joueurs en ont profité d'abord avec les Ryzen 9000 ; les Epyc n'en bénéficient que maintenant.
Madhu Rangarajan, qui dirige l'activité calcul et IA d'entreprise d'AMD, explique que les clients devaient jusqu'ici choisir entre fréquence élevée et 3D V-Cache. Il pense que Venice-X sera bien plus largement adopté dans le HPC.
Pourquoi trois ans d'absence
Les derniers Epyc X datent de 2023, et la 5e génération, fin 2024, n'a pas eu de Turin-X. C'était voulu, affirme Rangarajan : le marché du HPC d'entreprise suit un rythme plus lent, et AMD ne propose pas de version X à chaque génération.
AMD aurait pu désactiver des cœurs d'un Venice à 256 cœurs pour obtenir un rapport cache/cœur comparable, comme avec l'Epyc 9175F (16 cœurs, 512 Mo de cache). La fréquence maximale serait toutefois de 4,1 GHz au lieu de 5,3 GHz. « Pour la première fois, on obtient le plus grand L3 dans notre modèle le plus rapide », résume-t-il.
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