AMD Epyc Venice-X: 3D V-Cache की वापसी, 5.3 GHz क्लॉक स्पीड के साथ
AMD तीन साल बाद कैश-प्रधान Epyc X सीरीज़ वापस ला रही है। Venice-X में 96 कोर, 1 GB से ज़्यादा L3 और 5.3 GHz क्लॉक होगी, पर यह 2027 के अंत में आएगी।

AMD अपनी कैश-प्रधान Epyc X सीरीज़ को तीन साल के अंतराल के बाद फिर बाज़ार में उतारने जा रही है। नई Venice-X चिप में अधिकतम 96 कोर होंगे और कंपनी की 3D V-Cache स्टैकिंग तकनीक से L3 कैश एक गीगाबाइट से ऊपर पहुँच जाएगा। लेकिन इसके लिए इंतज़ार करना होगा: AMD के मुताबिक Venice-X की शुरुआती सप्लाई 2027 की दूसरी छमाही में शुरू होगी।
किन कामों के लिए बनी है
ये चिप्स इसी साल CES में पेश किए गए थे और मुख्य रूप से कम लेटेंसी वाले तकनीकी और वैज्ञानिक कंप्यूटिंग वर्कलोड के लिए हैं, जैसे कंप्यूटेशनल फ़्लूड डायनामिक्स और इलेक्ट्रॉनिक डिज़ाइन ऑटोमेशन (EDA)। AMD खुद फ़ंक्शनल वेरिफ़िकेशन जैसे EDA कामों में X-सीरीज़ Epyc पर काफ़ी निर्भर है। AMD Fellow फ़िल स्टाइंके के अनुसार, मॉडल का बड़ा हिस्सा कैश में रहने से CPU कोर को सिस्टम मेमोरी से डेटा के आने-जाने का इंतज़ार कम करना पड़ता है।
हर चिप में अधिकतम आठ CPU डाई हैं और हर डाई पर 96 MB का SRAM टाइल जुड़ा है। इससे प्रति चिपलेट 144 MB और प्रति सॉकेट 1,152 MB L3 कैश मिलता है, यानी Genoa-X जितना ही। कोर संख्या और कैश नहीं बढ़े, पर क्लॉक स्पीड बढ़ी है: Genoa-X की 3.7 GHz के मुक़ाबले Venice-X 5.3 GHz तक जाती है।
क्लॉक और कैश में अब समझौता नहीं
Milan और Genoa पीढ़ी में ग्राहकों को ऊँची फ़्रीक्वेंसी या 3D V-Cache में से एक चुनना पड़ता था, क्योंकि SRAM टाइल ऊपर रखने से गर्मी फँसती थी और बूस्ट क्लॉक सीमित रहती थी। Zen 5 पीढ़ी में AMD ने SRAM टाइल को स्टैक के नीचे कर दिया, जिससे चिप ज़्यादा गर्म होकर भी लंबे समय तक तेज़ चल सकती है। Ryzen 9000 में गेमर्स को यह फ़ायदा पहले मिला; Epyc में यह अब आ रहा है।
AMD के कंप्यूट और एंटरप्राइज़ AI कारोबार के प्रमुख मधु रंगराजन का मानना है कि इस बार HPC में अपनाया जाना पिछली पीढ़ियों से कहीं बड़ा होगा। Turin पीढ़ी में X मॉडल न आना सोच-समझकर लिया गया फ़ैसला था, क्योंकि एंटरप्राइज़ HPC बाज़ार की रफ़्तार धीमी रहती है। उनके मुताबिक सामान्य Venice के कोर बंद करके भी कैश-प्रति-कोर बढ़ाया जा सकता था, पर तब अधिकतम क्लॉक सिर्फ़ 4.1 GHz रहती।
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