AMD Epyc Venice-X recupera el 3D V-Cache con 5,3 GHz
Tras tres años de pausa, AMD relanza sus Epyc X con mucha caché: Venice-X ofrece hasta 96 núcleos, más de 1 GB de L3 y 5,3 GHz, pero llegará a finales de 2027.
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giftdetect· el regalo adecuado en minutosAMD recupera sus procesadores Epyc X, cargados de caché. Los Venice-X, orientados a computación de alto rendimiento (HPC), ofrecerán hasta 96 núcleos y, con la tecnología de apilado 3D V-Cache, triplicarán la densidad de caché L3 hasta superar un gigabyte por socket. Aún habrá que esperar: AMD prevé que empiecen a distribuirse en la segunda mitad de 2027.
Presentados como adelanto en el CES a comienzos de año, los chips se dirigen a cargas técnicas y científicas sensibles a la latencia, como la dinámica de fluidos computacional y la automatización del diseño electrónico (EDA). AMD usa sus propios Epyc X en tareas de EDA como la verificación funcional, que simula el silicio para comprobar que se comporta como debe. Según Phil Steinke, AMD Fellow, al mantener más del modelo en caché, los núcleos esperan menos a que los datos entren y salgan de la memoria del sistema.
Misma caché, frecuencias mucho mayores
Cada uno de los hasta ocho dies de CPU se une a una pastilla SRAM de 96 MB, lo que suma 144 MB de L3 por chiplet y 1.152 MB por socket, igual que en los Genoa-X a los que sustituyen. El cambio está en la frecuencia: Venice-X alcanza 5,3 GHz frente a los 3,7 GHz de Genoa-X.
La clave es el empaquetado. Antes la SRAM se apilaba sobre el chiplet de cómputo, atrapaba calor y limitaba las frecuencias. Con Zen 5, AMD movió la pastilla SRAM debajo del die de cómputo, de modo que los chips pueden funcionar más calientes y rápidos durante más tiempo. Los jugadores lo notaron primero en los Ryzen 9000; en Epyc llega ahora.
Madhu Rangarajan, responsable del negocio de computación e IA empresarial de AMD, explica que los clientes tenían que elegir entre alta frecuencia y 3D V-Cache. Cree que Venice-X tendrá una adopción mucho mayor en HPC.
Por qué tres años de ausencia
Los últimos Epyc X salieron en 2023 y la quinta generación, a finales de 2024, no tuvo Turin-X. Fue intencionado, según Rangarajan: el mercado HPC empresarial avanza a un ritmo más lento y AMD no lanza una versión X en cada generación.
AMD podría haber desactivado núcleos de un Venice de 256 para lograr una relación caché por núcleo similar, como hizo con el Epyc 9175F, de 16 núcleos y 512 MB de caché. Pero entonces la frecuencia máxima sería de 4,1 GHz y no de 5,3 GHz. «Por primera vez, se puede tener el L3 más grande en nuestro modelo de mayor frecuencia», afirmó.
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